西迪斯对于超小型无源晶体有着独特的见解,并提供高效的解决方案416F380XXASR，高速电流转向逻辑[HCSL]输出是外设组件互连快速[PCIe]应用，英特尔和英伟达芯片组之间别人。HCSL是差动输出标准，类似到LVPECL，提供高阻抗输出快速切换时间。其他优势包括与LVDS输出晶振和相比的平均功耗LVPECL和低相位抖动性能。

差动输出有一个15mA的电流源来自一个开放的发射器或源，有不终止的漏极，需要外部50欧姆电阻端到地。如果需要，10到30欧姆的系列可增加电阻以减少超调或振铃波形.

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PCIe是由PCI特殊兴趣组(PCI SIG)开发的串行点对点互连标准，最初用于帮助电脑制造商实施英特尔规范。然而，由于它的低成本和高数据吞吐量，PCIe已经在多个应用标准中采用包括刀片服务器、数据存储[SATAe & M.2]，嵌入式计算，3D图形、网络[千兆以太和和通信平台。在考虑到它的普及、简单和可扩展性;PCIe电接口主要应用于asic、fpga和soc。这为设计师提供灵活的解决方案用于系统中的高速数据传输。

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PCIe的基本架构是由两个设备之间的数据链路组成，可以有1 ~ 32个通道。PCIe链路分为x1、x2、x4、x8、x12、x16和x32。每条车道由差动导线对，一对用于发送[Tx]，另一对用于接收[Rx]数据。一个单车道将以每周期1位的速率传输数据，因此增加更多的车道将增加传输速率。

美国CTS晶振公司研发发现需要一个外部参考时钟来传输数据。标准时钟要求包括频率100MHz，最大稳定性±300ppm和HCSL输出。虽然从PCIe1.0到PCIe4.0，参考时钟频率对所有PCIe一代保持相同，抖动要求得到了改进，以支持后续版本中更高的传输速率。表1概述了PCIe时钟抖动的历史要求，以及突出显示将于2019年开发的新Gen5.0标准。

416F40013CKR	CTS晶振	416	MHz Crystal	40MHz
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416F400X2ADR	CTS晶振	416	MHz Crystal	40MHz

参考时钟的抖动直接影响设备间数据传输的效率。改善在抖动性能帮助消除延迟的数据传输和客户有两种产生时钟信号的选择用于PCIe数据传输。

1]一个100MHz的HCSL输出时钟振荡器和一个缓冲器产生多个时钟信号。

2]一个25MHz的晶体和一个PLL，该PLL乘以基准产生100MHz的时钟信号。CTS解决方案提供了一个低抖动的时钟振荡器需要上面的第1项。

416F400X2AKR	CTS晶振	416	MHz Crystal	40MHz
416F400X2ALR	CTS晶振	416	MHz Crystal	40MHz
416F400X2ASR	CTS晶振	416	MHz Crystal	40MHz
416F400X2ATR	CTS晶振	416	MHz Crystal	40MHz
416F400X2CAR	CTS晶振	416	MHz Crystal	40MHz
416F400X2CDR	CTS晶振	416	MHz Crystal	40MHz
416F400X2CKR	CTS晶振	416	MHz Crystal	40MHz
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416F40611AAR	CTS晶振	416	MHz Crystal	40.61MHz
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416F40611CKR	CTS晶振	416	MHz Crystal	40.61MHz
416F40611CLR	CTS晶振	416	MHz Crystal	40.61MHz
416F40611CSR	CTS晶振	416	MHz Crystal	40.61MHz
416F40611CTR	CTS晶振	416	MHz Crystal	40.61MHz
416F40612AAR	CTS晶振	416	MHz Crystal	40.61MHz
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PCIe标准是一项核心技术，用于在多个应用标准中互连外围设备。随着PCIe 5.0的开发，它将使400GE的大规模采用技术，因为它的全双工带宽约128GB/s的16车道系统。这将成为下一代关键技术所需的支持响应时间和高5G和物联网的带宽要求。

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此文关键字： CTS贴片晶振低抖动晶振

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